verilogHDL中 reg[n-1:0] mema;与 reg mema [n-1:0] ;两个语句是相同的,都是定义了reg型变量mema。


verilogHDL中 reg[n-1:0] mema;与 reg mema [n-1:0] ;两个语句是相同的,都是定义了reg型变量mema。

A.正确

B.错误

正确答案:错误


Tag:变量 语句 定义 时间:2024-01-14 21:02:27