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若一个源文件中有多个模块，则其中只能有一个顶层模块，且其名与文件同名，其它的为子模块。（）
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若一个源文件中有多个模块，则其中只能有一个顶层模块，且其名与文件同名，其它的为子模块。（）
A.正确
B.错误
正确答案：正确
Tag：
模块
源文件
其名
时间：2024-01-14 21:02:25
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if（表达式）与 if（表达式= = 1），表达含义一样，前者是后者的简写。
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verilogHDL程序中，模块的输入/输出信号类型如果缺省，默认为wire型。（）
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下列符号常量的定义， 合法的格式有（）。
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在verilogHDL中，整常数有三种表示方式，表达成197的方式，则默认这是一个十进制数，默认位宽是（）位。
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下列标识符中根据verilogHDL语法，合法的标识符是（）。
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已知某4变量输入的函数，输入变量为D3、D2、D1、D0，若把输入看作1位的BCD码，当被4整除时，则输出Y为1，反之为0，则该函数的最小项和的表达式是（）。
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二进制译码器相当于是一个最小项发生器，所以可以用来实现组合逻辑电路。（）
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共阳极接法发光二极管数码显示器需选用有效输出为低电平的七段显示译码器来驱动。（）
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对两个一位二进制数进行判断， 若A<；B，则输出Y为1，否则输出Y为0，表达式为（）。
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逻辑函数 Y（A，B，C）=AC+B′C 的最大项积的形式是（）。
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逻辑函数 Y（A，B，C）= AC + BC’ 的最小项和的形式是（）。
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逻辑函数； F（A、B、C）= M0M1M2M4的 最小项表示式为（）。
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以下几个表达式中，按照逻辑代数运算法则分析，正确的有（）。
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利用无关项化简逻辑函数时，无关项应看成（）。