首页
编码器任意时刻都只有一个输入有效，故编码器只允许一个输入端输入有效信号。
精华吧
→
答案
→
超星尔雅学习通未分类
编码器任意时刻都只有一个输入有效，故编码器只允许一个输入端输入有效信号。
A.正确
B.错误
正确答案：B
Tag：
电子技术
编码器
信号
时间：2022-04-07 15:45:11
上一篇：
组合逻辑电路根据需要可以加入反馈回路。
下一篇：
甲类功率放大器的最大效率为50%
相关答案
1.
2线—4线译码器有（）
2.
要完成BCD码转换器为数码管显示的段码，需用的电路为（）
3.
集成边沿D触发器的输出状态取决于CP=1期间输入D的状态。
4.
所谓上升沿触发，是指触发器的输出状态变化是发生在CP=1期间。
5.
JK触发器在J=K=1时，每来一个CP脉冲，触发器就翻转一次，故知JK触发器具有计数功能。
6.
同步RS触发器、D触发器、JK触发器都是无穷翻的触发器。
7.
一个4位二进制加法计数器起始状态为1001，当最低位接收到4个脉冲时，触发器状态为（）
8.
N个触发器可以构成能存放（）位二进制数码的寄存器。
9.
用与非门构成的基本RS触发器，欲使该触发器保持原状态，则输入信号应为（）
10.
为了减小放大电路的输入电阻，应引入（）负反馈
热门答案
1.
为了增大放大电路的输入电阻，应引入（）负反馈
2.
为了稳定放大电路的输出电流，应引入（）负反馈
3.
一位8421BCD码计数器至少需要（）个触发器。
4.
8421BCD码十进制计数器的状态为1000，若再输入6个计数脉冲，则计数器的新状态是（）
5.
同步时序逻辑电路与异步时序逻辑电路相比较，其差异在于后者（）
6.
要产生10个顺序脉冲，若用4位双向移位寄存器74LS194来实现，需要（）片。
7.
8位移位寄存器，串行输入时经（）个脉冲后，8位数码全部存入寄存器中。
8.
欲设计0-7这几个数的计数器，如果设计合理，采用同步二进制计数器，最少应使用（）级触发器。
9.
全加器的输出不仅仅取决于输入，同时还取决于相邻低位的进位，因此说全加器属于时序逻辑电路。
10.
编码器，译码器，数据选择器都属于组合逻辑电路。