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在多数码管动态扫描显示电路中，74X153集成块属于（）
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在多数码管动态扫描显示电路中，74X153集成块属于（）
A.八选一数据选择器
B.四选一数据选择器
C.数据分配器
D.译码器
正确答案：B
Tag：
数据
译码器
集成块
时间：2024-06-21 15:39:22
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在多数码管动态扫描显示电路中，74X48集成块属于（）
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在多数码管动态扫描显示电路中，一块74X139集成块中有（）个相同逻辑单元。
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1.
一个触发器可记录一位二进制代码，它有（）个稳定状态。
2.
触发器是边沿触发的存储元件。
3.
时钟脉冲的上升沿是指低电平变为高电平的动态过程。
4.
基本RS锁存器存在约束项。
5.
触发器的存储状态仅在时钟脉冲边沿（上升沿或下降沿）才有可能发生改变。
6.
锁存器是电平敏感的存储元件。
7.
如图所示符号，属于（）的逻辑符号图
8.
基本RS锁存器可由与非门构成，也可由或非门构成。
9.
描述锁存器逻辑功能的方法有（）
10.
使用与非门组成的基本RS锁存器电路中不存在反馈。
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1.
时钟脉冲的下升沿是指低电平变为高电平的动态过程。
2.
上升沿触发的边沿D触发器在时钟脉冲CP上升沿到来前输入D=1，而在CP上升沿过后输入D变为0，请问，在这个CP上升沿后，下一个上升沿到来前，触发器状态为（）。
3.
在数字系统中，时钟脉冲信号本质上就是一定频率的矩形波。
4.
边沿触发器只有时钟脉冲上升沿或下降沿时，它的输出状态才有可能改变。
5.
欲使边沿JK触发器随时钟边沿的变化，按Qn+1=1工作，需将JK触发器的输入端设置为（）
6.
边沿JK触发器，具有的逻辑功能有（）
7.
时序逻辑电路包含组合电路为和存储单元，在时序逻辑电路中，组合电路可以没有，但存储单元却不可或缺。
8.
将边沿JK触发器的输入端J和输入端K相连接，即可构成边沿D触发器。
9.
Mealy型时序逻辑电路的输出与输入和触发器状态两者有关，而Moore型时序逻辑电路仅与触发器的状态有关。
10.
同步时序电路是逻辑电路的存储单元使用同一种类型的触发器。