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时序逻辑电路一共有3个状态，那么需要使用（）个触发器来进行设计。
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时序逻辑电路一共有3个状态，那么需要使用（）个触发器来进行设计。
A.1
B.2
C.4
D.8
正确答案：B
Tag：
触发器
时序
电路
时间：2022-04-18 20:17:23
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4级触发器组成的十进制计数器，其无效状态数为（）个
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