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在组合逻辑电路中，任何时刻的输出仅仅取决于该时刻的（），与电路原来的（）无关。
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在组合逻辑电路中，任何时刻的输出仅仅取决于该时刻的（），与电路原来的（）无关。
正确答案：输入；状态
Tag：
电路
时刻
逻辑
时间：2024-03-15 22:46:35
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在数字电路中，正逻辑是指用逻辑（）表示高电平，用逻辑（）表示低电平。
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